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Originalveröffentlichung
DOI: 10.1109/TCAD.2015.2391254
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Zitationen: 36
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Zitationen: 29

Evaluation of Hybrid Memory Technologies using SOT-MRAM for On-Chip Cache Hierarchy

Oboril, Fabian; Bishnoi, Rajendra; Ebrahimi, Mojtaba; Tahoori, Mehdi B.



Zugehörige Institution(en) am KIT Institut für Technische Informatik (ITEC)
Publikationstyp Zeitschriftenaufsatz
Jahr 2015
Sprache Englisch
Identifikator ISSN: 0278-0070
KITopen ID: 1000048566
Erschienen in IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems
Band 34
Heft 3
Seiten 367-380
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