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Ein Entwurfsverfahren für mehrstufige Schaltnetze unter Gate-Array-Randbedingungen

Dao Trong, Son



Zugehörige Institution(en) am KIT Institut für Technik der Informationsverarbeitung (ITIV)
Publikationstyp Hochschulschrift
Jahr 1984
Sprache Deutsch
Identifikator ISBN: 3-18-144609-2
KITopen-ID: 1000087226
Verlag VDI-Verlag, Düsseldorf
Umfang 218 S.
Serie Verein Deutscher Ingenieure: Fortschrittberichte der VDI-Zeitschriften. Reihe 9, Elektrotechnik, Elektronik ; 46
Abschlussart Dissertation
Fakultät Fakultät für Elektrotechnik und Informationstechnik (ETIT)
Institut Institut für Technik der Informationsverarbeitung (ITIV)
Prüfungsdatum 24.07.1984
Referent/Betreuer Prof. U. G. Baitinger
KIT – Die Forschungsuniversität in der Helmholtz-Gemeinschaft
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