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Automatic Floorplanning and Standalone Generation of Bitstream-Level IP Cores

Khan, Nadir; Castro-Godinez, Jorge; Xue, Shixiang; Henkel, Jörg; Becker, Jügen



Originalveröffentlichung
DOI: 10.1109/TVLSI.2020.3023548
Zugehörige Institution(en) am KIT Institut für Technik der Informationsverarbeitung (ITIV)
Institut für Technische Informatik (ITEC)
Publikationstyp Zeitschriftenaufsatz
Publikationsjahr 2020
Sprache Englisch
Identifikator ISSN: 1063-8210, 1557-9999
KITopen-ID: 1000125032
Erschienen in IEEE transactions on very large scale integration (VLSI) systems
Seiten 1–13
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