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Fast Resource and Timing Aware Design Optimisation for High-Level Synthesis

Bannwart Perina, Andre; Silitonga, Arthur 1; Becker, Jürgen 1; Bonato, Vanderlei
1 Karlsruher Institut für Technologie (KIT)


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Originalveröffentlichung
DOI: 10.1109/TC.2021.3112260
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Zitationen: 1
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Zitationen: 2
Zugehörige Institution(en) am KIT Institut für Technik der Informationsverarbeitung (ITIV)
Publikationstyp Zeitschriftenaufsatz
Publikationsjahr 2021
Sprache Englisch
Identifikator ISSN: 0018-9340, 1557-9956, 2326-3814
KITopen-ID: 1000137949
Erschienen in IEEE transactions on computers
Verlag Institute of Electrical and Electronics Engineers (IEEE)
Band 70
Heft 12
Seiten 2070-2082
Vorab online veröffentlicht am 14.09.2021
Nachgewiesen in Dimensions
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