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Implementing a methodology for formally verifying RISC processors in HOL

Tahar, Sofiene; Kumar, Ramayya



Zugehörige Institution(en) am KIT Institut für Rechnerentwurf und Fehlertoleranz (IRF)
Publikationstyp Buchaufsatz
Jahr 1994
Sprache Englisch
Identifikator KITopen ID: 32194
Erscheinungsvermerk In: Higher order logic theorem proving and its applications. Ed.: J.J. Joyce. Berlin 1994. S. 281-294. (Lecture notes in computer science. 780.)
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