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RIVER: reconfigurable pre-synthesized-streaming architecture for signal processing of FPGAs

Brugger, C.; Hillenbrand, D.; Balzer, M.

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Volltext §
DOI: 10.5445/IR/220086803
Coverbild
Zugehörige Institution(en) am KIT Institut für Prozessdatenverarbeitung und Elektronik (IPE)
Publikationstyp Poster
Jahr 2012
Sprache Englisch
Identifikator KITopen-ID: 220086803
HGF-Programm 55.51.20 (POF II, LK 02)
Erscheinungsvermerk Internat.Conf.on High Performance and Embedded Architecture and compilers (HiPEAC 2012), Paris, F, January 23-25, 2012
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